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Verilog


El código escrito debajo ejemplifica la simplicidad y eficacia de Verilog.
Usted cree que este decodificador de 3 a 8 está correctamente descripto?

 1 module decoder (
 2   input      [2:0] dec_inp,
 3   input      en,
 4   output reg [7:0] dec_out);
 5
 6 always @* 
 7  begin
 8     dec_out = 8'hff;
 10    dec_out[dec_inp] = !en;
 11  end
 12
 13 endmodule

Si desea conocer la respuesta . . . . solo tiene que pedirla. . . .




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